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Questions and Answers
Qual è la formula per calcolare il throughput di un sistema SISD con pipelining?
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Quanti cicli di clock sono necessari per elaborare N istruzioni in un modello SISD con pipeline a K stadi?
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Qual è il guadagno massimo nello speed-up di un sistema SISD con pipelining?
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Qual è un fattore limitante della potenzialità della pipeline?
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Quale dichiarazione è vera riguardo alle pipeline nei modelli SISD?
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Quali sono le caratteristiche delle architetture CISC?
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Cos'è una delle principali differenze tra architetture CISC e RISC?
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Quale affermazione è vera riguardo agli approcci CISC?
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Quale affermazione descrive meglio le architetture RISC?
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Perché le architetture CISC sono considerate vantaggiose per la programmazione ad alto livello?
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Qual è la principale caratteristica dell'architettura CISC?
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In quale modello il processore esegue un flusso di istruzioni su un insieme di dati scalari?
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Qual è il vantaggio principale del pipelining nel modello SISD?
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Qual è una limitazione architetturale del modello SISD?
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Quale tecnica può essere utilizzata per superare il collo di bottiglia nel modello SISD?
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Quale affermazione è vera riguardo al modello MIMD?
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Qual è il numero di registri nella famiglia processori Intel IA-64?
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Quale non è un modello della classificazione di Flynn?
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Cosa rappresenta la latenza nel contesto del pipelining?
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Qual è la caratteristica delle istruzioni della famiglia di processori IA-32?
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Cosa causa un conflitto RAW?
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Qual è una tecnica utilizzata per ridurre il blocco della pipeline causato da istruzioni di salto condizionato?
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Cosa succede quando un salto condizionato viene effettuato in presenza di Delayed branch?
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Qual è un effetto negativo del riordino delle istruzioni per gestire le dipendenze?
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Quale tipo di istruzione non richiede necessariamente tutti gli stadi della pipeline?
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Quale delle seguenti affermazioni è vera riguardo all'architettura RISC in relazione alla pipeline?
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Cosa viene memorizzato in una Tabella della storia dei salti?
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Qual è un aspetto negativo del fatto che ogni istruzione si assume che richieda tutti gli stadi della pipeline?
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Study Notes
Introduzione
- Si parla di classificazione delle architetture.
Classificazione in base al numero di istruzioni eseguibili
- Architetture CISC (Complex Instruction Set Computer): Il set di istruzioni è composto da molte istruzioni con lunghezza variabile. Include sia istruzioni semplici che complesse, che necessitano dell'unità di controllo microprogrammata per l'esecuzione.
- Architetture RISC (Reduced Instruction Set Computer): Il set di istruzioni è costituito da un numero ridotto di istruzioni a lunghezza fissa. Comprende solo istruzioni semplici, che possono essere eseguite velocemente dall'unità di controllo cablata.
Architetture CISC
- L'approccio CISC è stato sviluppato per facilitare la programmazione ad alto livello.
- L'uso di linguaggi ad alto livello crea uno scarto tra le operazioni consentite dal linguaggio e quelle dell'architettura del calcolatore.
- Le architetture CISC hanno un ricco insieme di istruzioni macchina, simili ai comandi di alto livello.
- Questo permette compilatori meno complessi e codice eseguibile più compatto.
Architetture RISC
- L'approccio RISC non usa la microprogrammazione.
- Le architetture RISC dispongono di poche istruzioni macchina semplici.
- Le istruzioni prevedono operandi nei registri.
- Solo poche istruzioni (es. Load e Store) fanno riferimento alla memoria.
- Le architetture RISC dispongono di molti registri generali.
- Le architetture RISC usano semplici formati di indirizzamento.
- Ogni istruzione macchina è completata in un ciclo macchina.
Architetture CISC e RISC
- IA-32 (famiglia processori Intel fino al Pentium IV): è di tipo CISC. Le istruzioni macchina hanno lunghezza variabile, sono difficili da decodificare velocemente, e molti riferimenti alla memoria.
- IA-64 (nuova famiglia processori Intel a partire da ITANIUM): è di tipo RISC. Le istruzioni macchina hanno lunghezza fissa, sono facili da decodificare, con molti registri e poche istruzioni con riferimenti alla memoria.
Classificazione di Flynn (1972)
- SISD (Single Instruction Single Data): Un singolo processore esegue un flusso di istruzioni su un singolo insieme di dati.
- SIMD (Single Instruction Multiple Data): Un'istruzione macchina viene eseguita simultaneamente su più insiemi di dati.
- MISD (Multiple Instruction Single Data): Più processori eseguono diverse sequenze di istruzioni su un singolo insieme di dati (modello non comune).
- MIMD (Multiple Instruction Multiple Data): Più processori eseguono simultaneamente diverse sequenze di istruzioni su diversi insiemi di dati. (multiprocessori o multicomputer)
Modello SISD
- Il modello di Von Neumann, basato su un unico processore che esegue una sola istruzione per volta su un dato scalare.
- Le istruzioni vettoriali sono trasformate in istruzioni scalari eseguite sequenzialmente.
- L'esecuzione è strettamente sequenziale (solo un'istruzione per volta).
- L'ordine di esecuzione è definito dal programma.
- Un'immagine mostra la CPU, la memoria e le periferiche connessi da un bus.
- Il bus ha un limite architetturale, il collo di bottiglia, perché il processore può prelevare una istruzione alla volta dalla memoria.
Modello SISD con Pipeline
-
L'esecuzione dell'istruzione è divisa in più stadi (fetch, decode, operand fetch, execute, write back).
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La tecnica del pipelining sovrappone gli stadi di diverse istruzioni, migliorando l'efficienza.
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Ogni stadio è gestito da un'unità HW dedicata.
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Lo schema mostra le diverse fasi del ciclo d'istruzione e le unità coinvolte.
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La pipeline a cinque stadi è illustrata con un diagramma temporale che mostra la sovrapposizione temporale delle istruzioni.
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Il modello SISD basato su pipelining rimane seriale nella sequenza temporale delle istruzioni e nella successione dei loro stadi.
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L'esecuzione paralella succede a livello degli stadi del ciclo d'istruzione.
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Il vantaggio principale del pipelining è quello di aumentare la frequenza di completamento delle istruzioni, aumentando il throughput.
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Viene mostrata la latenza e il throughput.
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Il pipelining introduce difficoltà (hardware più complesso, consumo maggiore) che limitano la potenzialità in situazioni reali.
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Considerate le istruzioni di salto e le dipendenze tra le istruzioni (es. conflitto RAW).
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Soluzioni come branch prediction e delayed branch sono utilizzate per affrontare le dipendenze data.
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Non tutte le istruzioni necessitano di tutti gli stadi della pipeline.
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Description
In questo quiz esplorerai le differenze tra architetture CISC e RISC, con un focus sulla loro classificazione in base al numero di istruzioni eseguibili. Scoprirai come ciascun tipo di architettura influisca sulla programmazione e sull'esecuzione delle istruzioni. Testa le tue conoscenze su queste due importanti architetture informatiche.